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某芯片公司咨询PCIE4.0一致性测试方案 PCIe4.0 CBB CLB治具使用方法
发布时间: 2023-06-03 19:41 更新时间: 2024-12-03 09:31
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一、测试连接图示:

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一、示波器要求和设置:

1.带宽不低于16GHZ;

2.调用示波器默认设置;

3.不低于8 M存储数据;

4.使信号充满屏;

二、CLB测试设置(以X8某个Lane为例)

1.将开关SW5置于“ X8 COMP MODE SEL”位置;

2.将开关SW3置于“ X8 REF CLK”位置;

3.DUT上电,然后等待直到看到2.5 GT / s;

4.将开关SW5置于“ X8 REF CLK ”位置,此时示波器可以看到100MHZ的时钟;

5.保存波形;

6.使用开关SW2来切换速度,通过示波器可以看到速度的变化,然后重复步骤2-5;

三、SIGTEST测试(以GEN3为例)

1.打开SigTest;

2.选择“数据类型”作为“双端口单端”;

3.浏览并选择4个文件,其中2个用于数据(p,n),2个用于时钟(p,n);

4.选择“嵌入式测试模式”复选框;

5.单击“加载并验证数据文件”;

6.选择“ PCIE_3_0_SYS”为技术规范;

7.选择“ DUAL_PORT_MULTI_CTLE_DFE_EMBED01”为模板;

8.点击“测试”;

9.SigTest给出的结果,点击“查看HTML结果”

10.图示:


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五、出报告。


     我司有PCIE4.0 PCIE3.0 CBB CLB 测试治具租赁,可以提供技术咨询服务,欢迎咨询。

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